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文檔簡(jiǎn)介
1、1設(shè)計(jì)一個(gè)字節(jié)（8位）的比較器，要求：比較兩個(gè)字節(jié)的大小，如a［7：0］大于b［7：0］，則輸出高電平，否則輸出低電平；并改寫(xiě)測(cè)試模型，使其能進(jìn)行比較全面的測(cè)試。模塊源代碼：測(cè)試模塊的源代碼：仿真結(jié)果：由圖有：當(dāng)a=8＇01100101，b=8＇00010010（即ab時(shí)），輸出out為高電平；當(dāng)a=8＇00000001b=8＇00001101(即ab)out=1elseout=0endendmodule模塊源代碼：測(cè)試模塊源代碼：仿真
2、波形：4.在blocking模塊中按如下兩種寫(xiě)法，仿真與綜合的結(jié)果會(huì)有什么樣的變化？作出仿真波形，分析綜合結(jié)果。⑴⑵⑴模塊源代碼：⑵模塊源代碼：modulefdivision(resetF10MF500K)inputresetF10MoutputF500KregF500Kreg[7:0]jalways@(posedgeF10M)beginif(!reset)beginF500K=0j=0endelseif(j==199)beginj=0
3、F500K=~F500K#10000F500K=~F500Kendelsej=j1endendmodule`timescale1ns100ps`defineclk_cycle50modulefdivision_TopregresetregF10M_clkwireF500K_clkalways#`clk_cycleF10M_clk=~F10M_clkinitialbeginreset=1F10M_clk=0#100reset=0#100r
4、eset=1#49800$stop因?yàn)榍懊嬉呀?jīng)延遲了200個(gè)單位時(shí)間，再延遲49800個(gè)單位時(shí)間到達(dá)50000ns。endfdivisionuut(.reset(reset).F10M(F10M_clk).F500K(F500K_clk))endmodulealways@(posedgeclk)beginc=bb=aendAlways@(posedgeclk)b=aAlways@(posedgeclk)c=bmoduleblocking
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