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  • 鎖<em>存</em><em>器</em>的作用32

    鎖<em>存</em><em>器</em>的作用的作用(32頁)

    鎖存器的作用鎖存器的作用在LED和數(shù)碼管顯示方面,要維持一個(gè)數(shù)據(jù)的顯示,往往要持續(xù)的快速的刷新。尤其是在四段八位數(shù)碼管等這些要選通的顯示設(shè)備上。在人類能夠接受的刷新頻率之內(nèi),大概每三十毫秒就要刷新一次。這就大大占用了處理器的處理時(shí)間,消耗了處理器的處...

    下載價(jià)格:8 賞幣 / 發(fā)布人: 畢業(yè)設(shè)計(jì) / 發(fā)布時(shí)間:2024-03-13 / 12人氣

  • 《金<em>鎖</em>玉關(guān)面授精要》11

    《金<em>鎖</em>玉關(guān)面授精要》 《金玉關(guān)面授精要》(11頁)

    禪道網(wǎng)出品第1頁共11頁禪道網(wǎng)電話01081882938金鎖玉關(guān)面授精要金鎖玉關(guān)面授精要一、面授經(jīng)驗(yàn)集錦1。有很大地勢的大建築,或大山大川,就叫有氣勢。我們?nèi)『玫兀筚F地時(shí),一定要選氣勢大,氣魄大的大地,才有大作為,作出大事,出大貴人。才能氣運(yùn)長久,代代興旺。2...

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  • 74ls74 鎖<em>存</em><em>器</em>16

    74ls74 鎖<em>存</em><em>器</em> 74ls74 鎖(16頁)

    第三部分第三部分時(shí)序邏輯電路時(shí)序邏輯電路導(dǎo)讀如果電路在某一時(shí)刻的輸出狀態(tài)不僅取決于電路在這一時(shí)刻的輸入狀態(tài),而且與電路過去的狀態(tài)有關(guān),也就是說電路具有了記憶功能,這種電路就叫做時(shí)序邏輯電路。時(shí)序邏輯電路中能夠完成記憶功能的電路叫做觸發(fā)器,它是最重...

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  • 鎖<em>存</em><em>器</em>加固設(shè)計(jì)與應(yīng)用48

    鎖<em>存</em><em>器</em>加固設(shè)計(jì)與應(yīng)用加固設(shè)計(jì)與應(yīng)用(48頁)

    碩士學(xué)位論文碩士學(xué)位論文(工程碩士)鎖存器加固設(shè)計(jì)與應(yīng)用DESIGNAPPLICATIONOFRADIATIONHARDENEDLATCHES張釗張釗哈爾濱工業(yè)大學(xué)哈爾濱工業(yè)大學(xué)2011年6月CLASSIFIEDINDEXTN432UDC6213049774DISSERTATIONFTHEMASTER’SDEGREEINENGINEERINGDESIGNAPPLICATIONOFRADIATI...

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  • 鎖<em>存</em><em>器</em>加固設(shè)計(jì)與應(yīng)用.pdf48

    鎖<em>存</em><em>器</em>加固設(shè)計(jì)與應(yīng)用.pdf加固設(shè)計(jì)與應(yīng)用.pdf(48頁)

    深亞微米CMOS電路對(duì)外部輻射現(xiàn)象很敏感,有可能導(dǎo)致軟錯(cuò)誤的發(fā)生。因此,研究抗軟錯(cuò)誤的電路設(shè)計(jì)具有實(shí)際意義。由宇宙中粒子輻射引起的軟錯(cuò)誤通常有三類,包括單粒子翻轉(zhuǎn)SEUSINGLEEVENTUPSET,單粒子瞬態(tài)SETSINGLEEVENTTRANSIENT,單粒子閉鎖SELSINGLEEVENTLATCHUP。...

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  • 鎖<em>存</em><em>器</em>、觸發(fā)<em>器</em>、寄存<em>器</em>和緩沖<em>器</em>的區(qū)別8

    鎖<em>存</em><em>器</em>、觸發(fā)<em>器</em>、寄存<em>器</em>和緩沖<em>器</em>的區(qū)別、觸發(fā)、寄存和緩沖的區(qū)別(8頁)

    鎖存器、觸發(fā)器、寄存器和緩沖器的區(qū)別鎖存器、觸發(fā)器、寄存器和緩沖器的區(qū)別一、鎖存器一、鎖存器鎖存器(LATCH)對(duì)脈沖電平敏感,在時(shí)鐘脈沖的電平作用下改變狀態(tài)鎖存器是電平觸發(fā)的存儲(chǔ)單元,數(shù)據(jù)存儲(chǔ)的動(dòng)作取決于輸入時(shí)鐘(或者使能)信號(hào)的電平值,僅當(dāng)鎖存器處...

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  • 第五章 鎖<em>存</em><em>器</em>和觸發(fā)<em>器</em>7

    第五章 鎖<em>存</em><em>器</em>和觸發(fā)<em>器</em> 第五章 鎖和觸發(fā)(7頁)

    第五章鎖存器和觸發(fā)器第十五講教學(xué)內(nèi)容①基本RS觸發(fā)器的構(gòu)成及其工作原理;②時(shí)鐘控制觸發(fā)器的應(yīng)用點(diǎn)及其工作原理;③主從觸發(fā)器和邊沿觸發(fā)器的構(gòu)成及JK觸發(fā)器和D觸發(fā)器的應(yīng)用。教學(xué)要求①掌握兩器件的工作原理;②熟悉兩器件的應(yīng)用。教學(xué)難點(diǎn)①主從觸發(fā)器和邊沿觸發(fā)...

    下載價(jià)格:6 賞幣 / 發(fā)布人: 畢業(yè)設(shè)計(jì) / 發(fā)布時(shí)間:2024-03-11 / 13人氣

  • 三磁道磁卡讀<em>存</em><em>器</em>的設(shè)計(jì).pdf74

    三磁道磁卡讀<em>存</em><em>器</em>的設(shè)計(jì).pdf 三磁道磁卡讀的設(shè)計(jì).pdf(74頁)

    該系統(tǒng)是一款磁卡閱讀存儲(chǔ)器,根據(jù)用戶要求解決了普通閱讀器只能實(shí)時(shí)連接計(jì)算機(jī),不能單獨(dú)使用的問題。而且針對(duì)作為特殊用途的磁卡,要求三道磁道都記錄數(shù)據(jù),并且第三磁道記錄格式與標(biāo)準(zhǔn)規(guī)定的記錄格式不同時(shí),系統(tǒng)配套的應(yīng)用程序?qū)ζ渥隽苏_譯碼、顯示。整個(gè)系統(tǒng)...

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  • 連<em>鎖</em>超級(jí)市場、便利店管理通用要求門店管理規(guī)範(fàn)1範(fàn)圍本標(biāo)準(zhǔn)對(duì)連<em>鎖</em>3
  • 基于脈沖鎖<em>存</em><em>器</em>的關(guān)鍵路徑優(yōu)化.pdf79

    基于脈沖鎖<em>存</em><em>器</em>的關(guān)鍵路徑優(yōu)化.pdf 基于脈沖鎖的關(guān)鍵路徑優(yōu)化.pdf(79頁)

    分類號(hào)TN47學(xué)號(hào)GS12062482UDC密級(jí)公開工程碩士學(xué)位論文基于脈沖鎖存器的關(guān)鍵路徑優(yōu)化基于脈沖鎖存器的關(guān)鍵路徑優(yōu)化碩士生姓名鄒浩波學(xué)科領(lǐng)域軟件工程研究方向高性能微處理器設(shè)計(jì)指導(dǎo)教師方糧教授劉祥遠(yuǎn)副研究員劉必慰副研究員國防科學(xué)技術(shù)大學(xué)研究生院國防科學(xué)技術(shù)大...

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  • 加盟遭棄 連<em>鎖</em>業(yè)湧現(xiàn)直營浪潮5
  • 亂序處理<em>器</em>訪<em>存</em>行為建模.pdf76

    亂序處理<em>器</em>訪<em>存</em>行為建模.pdf 亂序處理行為建模.pdf(76頁)

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  • 基于虛擬SPM的加速<em>器</em>訪<em>存</em>架構(gòu).pdf90

    基于虛擬SPM的加速<em>器</em>訪<em>存</em>架構(gòu).pdf 基于虛擬SPM的加速架構(gòu).pdf(90頁)

    隨著處理器體系的發(fā)展,在通用多核處理器的結(jié)構(gòu)上擴(kuò)展加速核形成異構(gòu)多核處理器平臺(tái),已經(jīng)成為了高性能計(jì)算的趨勢之一。在通用多核處理器上集成加速核,給處理核之間的互連方式的設(shè)計(jì)、多核平臺(tái)下的存儲(chǔ)層次的設(shè)計(jì)提出了新的挑戰(zhàn)。異構(gòu)處理器平臺(tái)上互連方式與存儲(chǔ)層...

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  • 眾核處理<em>器</em>的訪<em>存</em>優(yōu)化及分析.pdf71

    眾核處理<em>器</em>的訪<em>存</em>優(yōu)化及分析.pdf 眾核處理的訪優(yōu)化及分析.pdf(71頁)

    長期以來,處理器和主存的性能分別按照不同的速度增長,達(dá)到一定的程度時(shí),處理器的快速增長對(duì)系統(tǒng)性能的提升逐漸被慢速發(fā)展的主存所屏蔽,從而產(chǎn)生存儲(chǔ)墻問題。存儲(chǔ)墻問題嚴(yán)重制約著眾核處理器系統(tǒng)性能的提升。為了解決存儲(chǔ)墻問題,業(yè)界提出了很多方法技術(shù),但是隨...

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  • 處理<em>器</em>訪<em>存</em>部件功能驗(yàn)證技術(shù)研究.pdf79

    處理<em>器</em>訪<em>存</em>部件功能驗(yàn)證技術(shù)研究.pdf 處理部件功能驗(yàn)證技術(shù)研究.pdf(79頁)

    自從集成電路誕生以來,對(duì)于集成電路設(shè)計(jì)的驗(yàn)證一直是集成電路設(shè)計(jì)的重要環(huán)節(jié)。到目前為止集成電路設(shè)計(jì)過程中對(duì)于驗(yàn)證所投入的時(shí)間及人力已遠(yuǎn)超過設(shè)計(jì)的投入,并且隨著設(shè)計(jì)復(fù)雜度的提高,驗(yàn)證投入將進(jìn)一步增加。本文以X微處理器訪存部件為驗(yàn)證對(duì)象,從功能點(diǎn)提取、測...

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  • 多核處理<em>器</em>共享級(jí)Cache訪<em>存</em>行為建模.pdf74

    多核處理<em>器</em>共享級(jí)Cache訪<em>存</em>行為建模.pdf 多核處理共享級(jí)Cache訪行為建模.pdf(74頁)

    隨著電子信息技術(shù)的迅速發(fā)展,多核處理器在嵌入式設(shè)備上得到了廣泛的應(yīng)用。在多核處理器層級(jí)的CACHE結(jié)構(gòu)中,共享級(jí)CACHE作為影響處理器性能的重要一環(huán),越來越受到學(xué)術(shù)界與工業(yè)界的重視。了解應(yīng)用程序的共享級(jí)CACHE行為表現(xiàn),不僅能夠?yàn)橛布藛T共享級(jí)CACHE設(shè)計(jì)空間...

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  • 基于訪<em>存</em>密度的內(nèi)存控制<em>器</em>調(diào)度研究.pdf61

    基于訪<em>存</em>密度的內(nèi)存控制<em>器</em>調(diào)度研究.pdf 基于訪密度的內(nèi)存控制調(diào)度研究.pdf(61頁)

    在CMP(CHIPMULTIPROCESS)系統(tǒng)中,內(nèi)存系統(tǒng)被多個(gè)同時(shí)執(zhí)行的線程共享。在共享的內(nèi)存系統(tǒng)中,一個(gè)線程的訪存請(qǐng)求不僅會(huì)被其它線程的請(qǐng)求延遲,而且也會(huì)破壞其它線程的訪存并行性。最終導(dǎo)致系統(tǒng)公平性和吞吐率下降,甚至有些線程會(huì)長期處于“饑餓”狀態(tài)。針對(duì)在CMP系...

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  • 微處理<em>器</em>訪<em>存</em>部件設(shè)計(jì)及結(jié)構(gòu)功能驗(yàn)證.pdf60

    微處理<em>器</em>訪<em>存</em>部件設(shè)計(jì)及結(jié)構(gòu)功能驗(yàn)證.pdf 微處理部件設(shè)計(jì)及結(jié)構(gòu)功能驗(yàn)證.pdf(60頁)

    高性能的微處理器設(shè)計(jì)是整個(gè)信息技術(shù)和計(jì)算機(jī)應(yīng)用市場競爭的重要焦點(diǎn)和關(guān)鍵內(nèi)容,因此設(shè)計(jì)高效的微處理器結(jié)構(gòu)具有重大的意義。本文主要研究RSIC處理器的結(jié)構(gòu)設(shè)計(jì),它是一個(gè)通用64位RISC結(jié)構(gòu),四發(fā)射的超標(biāo)量和超流水線微處理器,采用亂序執(zhí)行和先進(jìn)的CACHE設(shè)計(jì)等技術(shù)...

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  • <em>存</em>愛心作文1

    <em>存</em>愛心作文 愛心作文(1頁)

    存愛心存愛心存愛心湖北省宜昌市宜都市陸城第一小學(xué)五(1)班劉玉佳春節(jié)前夕的一天,街上行人川流不息。我和爸爸媽媽要到銀行去存錢。那天,雨下的很大,但街上的人卻一點(diǎn)也沒有減少,照樣從四面八方涌到城里辦年貨。我們來到了銀行存款的柜臺(tái)前,媽媽按照排隊(duì)的順序...

    下載價(jià)格:3 賞幣 / 發(fā)布人: 畢業(yè)設(shè)計(jì) / 發(fā)布時(shí)間:2024-03-10 / 9人氣

  • 多核處理<em>器</em>的訪<em>存</em>模擬與優(yōu)化技術(shù)研究.pdf123

    多核處理<em>器</em>的訪<em>存</em>模擬與優(yōu)化技術(shù)研究.pdf 多核處理的訪模擬與優(yōu)化技術(shù)研究.pdf(123頁)

    在工藝和應(yīng)用的雙重推動(dòng)下,多核結(jié)構(gòu)成為當(dāng)前高性能微處理器的發(fā)展趨勢。多核對(duì)單芯片有限CACHE、帶寬等存儲(chǔ)資源的競爭將進(jìn)一步凸顯訪存的瓶頸,同時(shí)伴隨著更加多樣的目標(biāo)應(yīng)用,微體系結(jié)構(gòu)研究采用的性能評(píng)估環(huán)境面臨新的要求。本文的研究主要圍繞多核處理器的性能模...

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