面向衛(wèi)星導航接收機應用的時鐘源與模數(shù)轉(zhuǎn)換器芯片設計.pdf_第1頁
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1、電子科技大學碩士學位論文面向衛(wèi)星導航接收機應用的時鐘源與模數(shù)轉(zhuǎn)換器芯片設計姓名：葉鵬申請學位級別：碩士專業(yè)：通信與信息系統(tǒng)指導教師：文光俊20090501ABSTRACTABSTRACTPhase—lockedloop(PLL)isacircuitwhichcarlsynchronizeitsoutputsignalwithaninputreferencesignalinfrequencyandphaseIt’Safundamental

2、andveryimportantmoduleinanalogandmixed—signalintegratedcircuitsBecauseofitsabilityoftracking，acquisitionandoperatingasanarrowbandfilter，PLLiswidelyusedinmanyfieldssuchasastronautics，communication，microprocessorandSOonOne

3、importantapplicationofPLLinmicroprocessoristoprovideon—chipclockforthesystemIthasbeenacoremoduleofmicroprocessorWiththedevelopmentofintegratedcircuitsandtheemergenceofSOC(SystemonaChip)technologyPLLhasplayedSOimportantar

4、oleinVLSIcircuitsandanalogintegratedcircuitsthatitisworthresearchingandesigningAnalog—to—digital(ADC)converteristhekeydeviceofadvancedcommunicationradaacousticsusceptanceandmanyconsumeeletronicsAsaspecialinterfaceconnect

5、swithanaloganddigitalcircuits，highperformanceanalogtodigitalconverterismoreandmoreimportantinwholesystemdesignNowthedevelopmentofthetechnologyhasmoreneedoftheperformanceoftheADC，especiallythespeedItevenhasbecomethekeyfac

6、torofthedeviceperformanceInthebasicoftheanalyzingofPLLandADC’Sbasicprincipleandtypicalschematics，thispaperdesignsa50MHzclockgeneratoranda2bitsADCthesamplingclockofADCistheoutputclockofPLLweanalysistheprincipleofPLLandADC

7、detaillyandweconstructatimimgmodelofPLLclockgeneratorinSIMULINKtocheckwhethertheparameterofPLLisrightthentheschematicsofPLLandADCaredesignedincadenceenvironmentwithJAZZ035urnBiCMOSprocess；thelayoutsofPLLandADCaredesigned

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